文獻標識碼： A
DOI：10.16157/j.issn.0258-7998.212004
中文引用格式： 顧泓，方震. 一款DVI視頻接收芯片的設計[J].電子技術應用，2022，48(3)：37-40.
英文引用格式： Gu Hong，Fang Zhen. Design of a DVI video receiver chip[J]. Application of Electronic Technique，2022，48(3)：37-40.
0 引言
DVI(Digital Visual Interface)芯片在數字視頻領域應用[1]廣泛且需求量巨大，如數字電視、個人電腦顯示屏、雷達顯示屏等均廣泛采用DVI技術[2-4]。國外對DVI技術的研究起步較早，數字顯示工作組DDWG(Digital Display Working Group)于1999年就推出了DVI 1.0接口標準。標準采用T.M.D.S(Transition Minimized Differential Signaling)技術[5-6]將8 bit像素數據轉換成10 bit進行串行傳輸，能夠支持三通道并行，各通道串行速率高達1.65 Gb/s的UXGA格式像素[7-8]傳輸。在傳輸速率較高、時鐘與數據相位關系不確定的情況下，接收端如何恢復數據[9]成為了接收端設計的關鍵。
過采樣技術[10]可以有效解決上述數據接收的問題并且易于實現，但是對鎖相環(Phase Locked Loop，PLL)的要求較高[11-12]。由于過采樣需要產生多個相位時鐘，如3倍過采樣就要產生多達30個相位的時鐘，這對PLL的設計是一個很大的挑戰。而本文采用的數據恢復方案基于3倍過采樣，只需PLL產生12個相位的時鐘，與文獻[13]相比大大減小了PLL的設計難度和功耗。文獻[14]會根據采樣結果產生相位調整信號輸出給相位調整電路，調整PLL輸出時鐘相位至合適區間，進而采樣恢復出數據。而本文采用基于全數字的數據恢復方案，可直接根據采樣結果分析恢復出數據，這樣無需時鐘相位調整電路，降低了芯片的硬件開銷，同時由于采用全數字邏輯實現，提高了電路的穩定性。
本文詳細內容請下載：http://www.viuna.cn/resource/share/2000003999。
作者信息：
顧 泓，方 震
(中科芯集成電路有限公司，江蘇 無錫214072)
