| 基于高性能FPGA的超高速IPSec安全設(shè)備設(shè)計(jì)與實(shí)現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：wwei | |
| 文檔大?。?span>1908 K | |
| 標(biāo)簽： 超高速 IPSec FPGA | |
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| 文檔介紹：基于高性能FPGA提出了一種超高速IPSec安全設(shè)備的設(shè)計(jì)方案；此方案在以CPU作為控制中樞的基礎(chǔ)上，利用高性能FPGA配合高速接口實(shí)現(xiàn)100G的IPSec安全傳輸，同時(shí)利用高性能FPGA和噪聲源芯片實(shí)現(xiàn)國(guó)密算法對(duì)高速數(shù)據(jù)進(jìn)行加解密。搭建測(cè)試環(huán)境對(duì)樣機(jī)進(jìn)行測(cè)試，測(cè)試結(jié)果表明，超高速IPSec安全設(shè)備可完成高達(dá)82 Gb/s吞吐率的IPSec安全傳輸，整個(gè)系統(tǒng)延時(shí)達(dá)90 μs級(jí)。 | |
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